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求教关于vivADo的DEBug问题

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要那么多勾勾叉叉毛得用,鼠标一点OK才是境界,vivado进步了。HLS的输出sh不能作为IP直接被ISE使用,源代码可以。关于信号优化和debugger,小意思。但是,我不好意思代劳。你都用vivado了,那肯定是Zynq或者7系列的机会,卖个关子,找你的FAE吧...

就报告来看,这example_design 是直接做在对外接口, 并行的输出输入直接挂在IO上了,连IO专用的设备都连上了 --要么给他制定 IO location, --要么内部做dummy逻辑接收下,并去掉他的专用IO器件

可能是你写入的bit文件和probe文件不匹配 The device design has 0 ILA core(s) and 0 VIO core(s). The probes file has 1 ILA core(s) and 0 VIO core(s).

首先第一步,需要把想要观测的信号标记出来,即mark_debug,有两种mark_debug的方法,我用verilog写了一个简单的流水灯程序,只有几行代码,如下: module main( input clk, input rst, output reg [7:0] led ); (*mark_debug = "true"*)reg

要那么多勾勾叉叉毛得用,鼠标一点OK才是境界,vivado进步了。HLS的输出sh不能作为IP直接被ISE使用,源代码可以。关于信号优化和debugger,小意思。但是,我不好意思代劳。你都用vivado了,那肯定是Zynq或者7系列的机会,卖个关子,找你的FAE吧...

用Vivado进行硬件调试,就是要插入ila核,即“集成逻辑分析仪”,然后将想要引出来观察的信号连到这个核的probe上。 首先第一步,需要把想要观测的信号标记出来,即mark_debug,有两种mark_debug的方法,我用verilog写了一个简单的流水灯程序,只...

Debug分为3个阶段: 1. 探测信号:在设计中标志想要查看的信号 2. 布局布线:给包含了debug IP的设计布局布线 3. 分析:上板看信号 一 探测信号 探测信号有2种方法一种是直接在HDL源代码中用(*mark_debug = “true”*)标识出要探测的信号 另一种...

编程人员,根据调试结果,找出出问题的程序语句,修改正确,就行了。

第步:标记需要debug信号 例: VHDL:attribute mark_debug of sineSel : signal is "true"; attribute mark_debug of sine : signal is "true"; Verilog: 需要debug信号前加 (* MARKDEBUG = "TRUE" *) 第二步:设置debug 首先打synthesis desig...

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